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地方门户网站系统,网络推广培训吧,灯饰如何做网站推广,企业做网站 乐云seo第一部分#xff1a;设计总目标——我们到底在追求什么#xff1f; 在进行所有具体设计之前#xff0c;首先要明白目标#xff1a;保证信号从芯片A发出#xff0c;能干净、准时、完整地到达芯片B#xff0c;同时电源稳定、不干扰别人也不被别人干扰。 这包含了三个核心设计总目标——我们到底在追求什么在进行所有具体设计之前首先要明白目标保证信号从芯片A发出能干净、准时、完整地到达芯片B同时电源稳定、不干扰别人也不被别人干扰。这包含了三个核心信号完整性信号波形不失真没有过冲、回沟、振铃。电源完整性送到芯片的电压稳定没有大的波动和噪声。电磁兼容性板子自身辐射的干扰小也能抵抗外界的干扰。第二部分设计步骤详解一、 叠层设计 —— 搭建PCB的“地基”和“骨架”叠层设计是高速设计的第一步决定了后续所有设计的性能上限。通俗理解就像盖楼房先要决定盖几层、每层是什么住宅、商场、停车场、层高多少。PCB叠层就是决定用多少层铜箔每层是走信号、接电源还是铺地以及它们之间的厚度。细化步骤定层数根据什么 主要看信号线数量特别是高速线、电源种类3.3V 1.8V 1.2V...越多可能需要独立的电源层、以及对噪声和屏蔽的要求。简单估算对于非常复杂的高速板如处理器、FPGA板常常是“信号层数 ≈ 电源地层数”。比如8层板常见结构是信号-地-信号-电源-地-信号-地-信号。EMC角度每两个高速信号层之间最好有一个完整的参考平面地或电源隔开这能提供良好的信号回流路径和屏蔽。定厚度和材料总板厚1.6mm最常用因为PCB加工、插件焊接、结构安装都最成熟。更厚的板如2.0mm强度更好但成本高过孔更难加工。核心材料FR4就像钢筋水泥。它的介电常数 Er 不是固定值频率越高Er会略有下降。一般仿真时取4.2或4.3。正切值 你可以理解为材料的“损耗因子”值越大高频信号在板材中能量损耗转换成热越严重。高速信号要用 “低损耗”板材如 Rogers Megtron但价格贵。定阻抗、定叠构阻抗目标单端50Ω差分100Ω是行业惯例是为了和芯片的驱动/接收能力、以及很多测试仪器端口匹配。如何实现 阻抗由 线宽W、介质厚度H、铜厚T、Er 共同决定。通常我们用阻抗计算软件如Polar SI9000根据板材供应商提供的参数H Er和你的阻抗目标反推出需要的线宽和间距。嘉立创阻抗匹配器嘉立创阻抗计算层叠结构原则对称防止PCB在高温下弯曲变形。例如顶层和底层的铜厚和介质厚度最好对称。参考平面就近每个高速信号层都必须紧邻一个完整的参考平面地最佳。电源地平面耦合核心电源和对应的地平面应尽量靠近形成一个天然的平板电容有助于滤波。二、 五种阻抗匹配方式 —— 消除反射的“消声器”通俗理解信号在传输线上走如果尽头是“开路”高阻抗或“短路”低阻抗就会像声音碰到墙壁产生回声一样产生反射。匹配就是在末端加个“吸声材料”让信号到那里能量被吸收没有反射。细化解读匹配方式啥时候用核心要点发送端串联点对点高速信号最常用如DDR的地址/控制线、时钟线。电阻Rs加在驱动芯片输出脚附近。阻值 传输线阻抗 - 芯片输出阻抗。它让信号“温和”地进入传输线但会让接收端信号幅度略有减小。接收端并联用在总线拓扑一驱多收的末端或者对功耗不敏感的低速场合。在接收端用一个电阻Rt拉到地。Rt值等于传输线阻抗。缺点是无论高低电平电阻上一直有电流费电。接收端分压用于需要特定端接电压的电路如某些旧式ECL逻辑或需要偏置的模拟信号。用两个电阻分压提供一个Vtt电压通常是电源电压一半。Rt1和Rt2并联值等于传输线阻抗。更费电。接收端阻容并联想省电又需要消除反射且对信号边沿要求不高的场合。利用电容隔直流的特性只有信号跳变瞬间有电流平时不耗电。但电容会减慢边沿不适合速度非常高的信号。接收端二极管并联防护第一匹配第二。用于保护输入引脚不被过压击穿。利用二极管钳位电压。它不能完美匹配阻抗只能削去过高的尖峰反射依然存在。常用于按键、接口等易受ESD骚扰的地方。一句话总结高速点对点信号首选发送端串联匹配。三、 信号回路与换层 —— 电流的“回家之路”核心思想电流必须形成一个闭合回路。高速信号的返回电流并不是“通过大地”回去的而是紧贴在信号线下方的参考平面地或电源上流回去的。换层要点详解最好不要改变参考层比如信号从顶层参考GND 换到内层3参考GND很好。返回电流直接在相邻的GND层上“跳”到过孔位置继续走。为什么最好不改变网络属性如果从顶层参考GND 换到内层3参考3.3V返回电流从GND平面到3.3V平面路径复杂环路面积增大产生噪声和辐射。如果必须换参考层确保两个参考层在换层过孔处非常近比如只隔了10mil的PP片。务必在信号过孔旁边50mil打一个连接这两个参考层的“缝合地/电源过孔”。这为返回电流提供了一个低阻抗的旁路通道防止它乱跑。密集换层时地孔之间保持距离是为了保证平面连接处的机械强度和电流通流能力。四、 地弹与串扰 —— 信号间的“相互干扰”地弹比喻芯片内部千军万马很多晶体管同时开关瞬间需要大电流。芯片引脚和PCB走线有微小电感大电流突变会在电感上产生电压波动VL*di/dt。结果就是芯片“感觉”到的地平面电压被“弹”起来了不再是0V。措施扇出用更多、更短的电源/地引脚和过孔减小电感。扰码让数据看起来更随机避免大量数据线同时从0变1从而减小瞬间电流di。低阻抗回路还是强调电源/地平面的低阻抗设计以及去耦电容要靠近引脚。串扰比喻并排走的两根线像平行天线一根线上的信号会“感应”到另一根线上这就是串扰。3W原则线中心间距 ≥ 3倍线宽可以避免70%的电场耦合。这是最实用、最重要的布线规则。降边沿速率在满足时序前提下用驱动器端的串联电阻稍稍减缓信号变化速度能显著减小串扰。带状线 vs 微带线微带线走在表层。优点方便调试、焊接。缺点一面是空气Er1一面是介质阻抗受环境绿油厚度影响大容易受外界干扰。带状线走在两个参考平面之间。优点阻抗易控制屏蔽好EMC性能佳。缺点调试困难。结论关键高速信号如时钟、差分对尽量走在内层带状线环境。五、 电源完整性 —— 芯片的“稳定粮仓”平面对间距电源和地平面越近形成的平板电容C ε * A / d 就越大这是最好的高频去耦电容。电容的引线电感这是头号敌人过孔越长、PCB焊盘到过孔的距离越长电感越大高频下电容就“失灵”了。所以电容必须尽量靠近芯片电源引脚并使用短而宽的走线连接。花焊盘给大电流引脚如电源芯片输入/输出敷铜时用“十字”或“多瓣”连接而不是实心连接。这可以防止焊接时散热太快导致虚焊同时保证足够的通流能力。六、 EMC设计 —— “安分守己抵抗骚扰”EMI我们板子产生的干扰。EMS我们板子抵抗外界干扰的能力。核心四板斧屏蔽、滤波、接地、隔离。几个具体措施20H/3H原则电源平面比地平面内缩20倍或至少3倍介质厚度的距离是为了减少边缘向外辐射的电场。法拉第电笼在板边密集打地孔到内部地平面就像给PCB内部电路做了一个金属笼子锁住电磁场。晶振处理晶振是强干扰源。下方所有层挖空是为了防止其高频噪声通过电容耦合到其他层。表层铺地并多打地孔是为了提供一个局部的屏蔽和回流路径。走线远离安装孔安装孔通常连接金属机壳地高速线靠近它会改变阻抗并产生辐射。七、 可测试性设计 —— 为“体检”预留的窗口非常重要 再好的设计无法测试和调试就等于“黑盒”。ICT测试点给自动测试机留出可以探针接触的焊盘用于测试元器件焊接是否正确、有无短路开路。旁边一定要有地测试点供探针形成参考。信号测试点给示波器、逻辑分析仪预留的测量点。可以是电阻、电容的焊盘或专门的测试座。同样需要 nearby ground。边界扫描通过芯片的JTAG口像“内窥镜”一样检查芯片内部逻辑和引脚连接对复杂BGA芯片的故障定位极其有用。给小白工程师的终极建议先模仿再创新找到公司或开源社区里成熟的、经过量产的同类高速板原理图和PCB仔细研究它的叠层、匹配、布局布线这是最快的成长路径。学会使用工具阻抗计算器必须会。SI/PI仿真软件如HyperLynx ADS 哪怕先用入门版做点简单仿真对理解概念帮助巨大。建立“回路思维”看到任何一根信号线立刻在脑子里想“它的电流从哪流回去”。敬畏规则理解本质3W原则、20H原则、匹配电阻要靠近发送端……这些规则背后都有深刻的电磁场原理。先遵守规则再慢慢理解为什么。